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【Verilog基础】定点小数的乘法运算

基础 运算 Verilog 乘法 小数
2023-09-11 14:20:35 时间

一、字长基本问题

字长(位宽)和小数部分字长共同构成了定点数的两个要素。以wl表示字长,fl表示小数部分字长,那么有符号定点数以Fix_wl_fl的形式表示,无符号定点数的字长以UFix_wl_fl的形式表示。对于定点小数,一旦wlfl确定,那么小数点的位置即可固定。

下表给出了Fix_5_3与十进制小数的对应关系:

在这里插入图片描述

在定点小数中,有一类值得关注,那就是只有一位整数位的定点小数。下表给出了Fix_5_4与十进制小数之间的对应关系。可见&#x