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【Verilog基础】逻辑综合(4)逻辑综合如何添加环境约束

逻辑基础 如何 环境 添加 约束 综合 Verilog
2023-09-11 14:20:35 时间

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工作条件包括三方面的内容: 温度、电压以及工艺。单元的延时会随着温度的上升而增加;随着电压的上升而减小;随着工艺尺寸的增大而增大。 这些工作条件一般分为三种:最好情况(best case)、典型情况(typical case)以及最差情况(worst case)。 一般综合只要考虑到最差和最好两种情况,最差情况用于作基于建立时间 (setup time)的时序分析,最好情况用于作基于保持时间(hold time)的时序分析。

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