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【校招Verilog手撕代码】VL1、众数统计电路

统计代码 Verilog 电路 校招 众数
2023-09-11 14:20:35 时间

题目一

统计连续8bit data_i的直方图,并实时输出当前出现次数最多的数字,如下图请写出详细代码。

在这里插入图片描述

module data_counter(
	input	wire		clk_i	,
	input 	wire		rst_n	,
	input	wire		vld_i	,
	input 	wire[7:0]	data_i	,
	
	output	reg [7:0]	data_cnt_max